VDE:一个基于图形的IC设计高层次输入验证系统

摘要：

集成电路的规模和复杂程度的增加，促使其设计方法向行为功能级别的高层次设计方法转移。ＶＨＤＬ和Ｖｅｒｉｌｏｇ在ＩＣ设计中逐步得到广泛的应用，但它们在直观地表达设计思想、设计重用、数据组织等方面有很多不如意之处。文中介绍一个基于图形描述的高层次设计环境ＶＤＥ（ＶＨＤＬ／Ｖｅｒｉｌｏｇ Ｄｅｓｉｇｎ Ｅｎｖｉｒｏｎｍｅｎｔ），它把繁复的语言用可视化的手段组织起来，是一个高层次设计输入、验证的集成环境。

关键词： 定值控制 动态重视度 模糊控制 模糊推论模型

作者: 黄国勇

作者单位: 华大集成电路设计中心

会议类型: 国内会议

会议名称: 中国科协第三届青年学术年会

会议地点: 北京

会议语种:中文

页码: 519～521

在线出版日期: 1998-08-01（万方平台首次上网日期，不代表论文的发表时间）